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http://hdl.handle.net/10201/34162
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Campo DC | Valor | Lengua/Idioma |
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dc.contributor.author | Sánchez Pedreño, Daniel | es |
dc.date.accessioned | 2013-05-10T11:28:57Z | - |
dc.date.available | 2013-05-10T11:28:57Z | - |
dc.date.issued | 2011 | es |
dc.identifier.uri | http://hdl.handle.net/10201/34162 | - |
dc.description | Texto en inglés, resumen en español. | es |
dc.description | Tesis-Universidad de Murcia. | es |
dc.description | Consulte la tesis en: BCA. GENERAL. ARCHIVO UNIVERSITARIO. TM 4249. | es |
dc.format | application/pdf | es |
dc.format.extent | 1 v. (pág. var.) | es |
dc.language | spa | es |
dc.publisher | Murcia : Universidad de Murcia, Departamento de Ingeniería y Tecnología de Computadores, | es |
dc.rights | Attribution-NonCommercial-NoDerivatives 4.0 International | es |
dc.rights | info:eu-repo/semantics/openAccess | es |
dc.rights.uri | http://creativecommons.org/licenses/by-nc-nd/4.0/ | es |
dc.subject | Ordenadores | es |
dc.subject | Arquitectura | es |
dc.subject.other | 004.3(043) | es |
dc.title | Diseño de arquitecturas para la mitigación de fallos hardware en procesadores multinúcleo = Microarchitectural approaches for hardware fault mitigation in multicore processors / Daniel Sánchez Pedreño; directores, Juan Luis Aragón Alcaraz, José Manuel García Carrasco. | es |
dc.type | info:eu-repo/semantics/doctoralThesis | es |
Aparece en las colecciones: | Tesis doctorales sin texto completo |
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